/* SPDX-License-Identifier: ISC */ /* Copyright (C) 2020 MediaTek Inc. * * Author: Sean Wang <[email protected]> */ #ifndef __MT76S_H #define __MT76S_H #define MT_PSE_PAGE_SZ … #define MCR_WCIR … #define MCR_WHLPCR … #define WHLPCR_FW_OWN_REQ_CLR … #define WHLPCR_FW_OWN_REQ_SET … #define WHLPCR_IS_DRIVER_OWN … #define WHLPCR_INT_EN_CLR … #define WHLPCR_INT_EN_SET … #define MCR_WSDIOCSR … #define MCR_WHCR … #define W_INT_CLR_CTRL … #define RECV_MAILBOX_RD_CLR_EN … #define WF_SYS_RSTB … #define WF_WHOLE_PATH_RSTB … #define WF_SDIO_WF_PATH_RSTB … #define MAX_HIF_RX_LEN_NUM … #define MAX_HIF_RX_LEN_NUM_CONNAC2 … #define WF_RST_DONE … #define RX_ENHANCE_MODE … #define MCR_WHISR … #define MCR_WHIER … #define WHIER_D2H_SW_INT … #define WHIER_FW_OWN_BACK_INT_EN … #define WHIER_ABNORMAL_INT_EN … #define WHIER_WDT_INT_EN … #define WHIER_RX1_DONE_INT_EN … #define WHIER_RX0_DONE_INT_EN … #define WHIER_TX_DONE_INT_EN … #define WHIER_DEFAULT … #define MCR_WASR … #define MCR_WSICR … #define MCR_WTSR0 … #define TQ0_CNT … #define TQ1_CNT … #define TQ2_CNT … #define TQ3_CNT … #define MCR_WTSR1 … #define TQ4_CNT … #define TQ5_CNT … #define TQ6_CNT … #define TQ7_CNT … #define MCR_WTDR1 … #define MCR_WRDR0 … #define MCR_WRDR1 … #define MCR_WRDR(p) … #define MCR_H2DSM0R … #define H2D_SW_INT_READ … #define H2D_SW_INT_WRITE … #define H2D_SW_INT_CLEAR_MAILBOX_ACK … #define MCR_H2DSM1R … #define MCR_D2HRM0R … #define MCR_D2HRM1R … #define MCR_D2HRM2R … #define MCR_WRPLR … #define RX0_PACKET_LENGTH … #define RX1_PACKET_LENGTH … #define MCR_WTMDR … #define MCR_WTMCR … #define MCR_WTMDPCR0 … #define MCR_WTMDPCR1 … #define MCR_WPLRCR … #define MCR_WSR … #define MCR_CLKIOCR … #define MCR_CMDIOCR … #define MCR_DAT0IOCR … #define MCR_DAT1IOCR … #define MCR_DAT2IOCR … #define MCR_DAT3IOCR … #define MCR_CLKDLYCR … #define MCR_CMDDLYCR … #define MCR_ODATDLYCR … #define MCR_IDATDLYCR1 … #define MCR_IDATDLYCR2 … #define MCR_ILCHCR … #define MCR_WTQCR0 … #define MCR_WTQCR1 … #define MCR_WTQCR2 … #define MCR_WTQCR3 … #define MCR_WTQCR4 … #define MCR_WTQCR5 … #define MCR_WTQCR6 … #define MCR_WTQCR7 … #define MCR_WTQCR(x) … #define TXQ_CNT_L … #define TXQ_CNT_H … #define MCR_SWPCDBGR … #define MCR_H2DSM2R … #define MCR_H2DSM3R … #define MCR_D2HRM3R … #define D2HRM3R_IS_DRIVER_OWN … #define MCR_WTQCR8 … #define MCR_WTQCR9 … #define MCR_WTQCR10 … #define MCR_WTQCR11 … #define MCR_WTQCR12 … #define MCR_WTQCR13 … #define MCR_WTQCR14 … #define MCR_WTQCR15 … enum mt76_connac_sdio_ver { … }; struct mt76s_intr { … }; #endif
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