/* SPDX-License-Identifier: GPL-2.0 * * Copyright 2016-2018 HabanaLabs, Ltd. * All Rights Reserved. * */ /************************************ ** This is an auto-generated file ** ** DO NOT EDIT BELOW ** ************************************/ #ifndef ASIC_REG_TPC0_EML_CFG_MASKS_H_ #define ASIC_REG_TPC0_EML_CFG_MASKS_H_ /* ***************************************** * TPC0_EML_CFG (Prototype: TPC_EML_CFG) ***************************************** */ /* TPC0_EML_CFG_DBG_CNT */ #define TPC0_EML_CFG_DBG_CNT_DBG_ENTER_SHIFT … #define TPC0_EML_CFG_DBG_CNT_DBG_ENTER_MASK … #define TPC0_EML_CFG_DBG_CNT_DBG_EN_SHIFT … #define TPC0_EML_CFG_DBG_CNT_DBG_EN_MASK … #define TPC0_EML_CFG_DBG_CNT_CORE_RST_SHIFT … #define TPC0_EML_CFG_DBG_CNT_CORE_RST_MASK … #define TPC0_EML_CFG_DBG_CNT_DCACHE_INV_SHIFT … #define TPC0_EML_CFG_DBG_CNT_DCACHE_INV_MASK … #define TPC0_EML_CFG_DBG_CNT_ICACHE_INV_SHIFT … #define TPC0_EML_CFG_DBG_CNT_ICACHE_INV_MASK … #define TPC0_EML_CFG_DBG_CNT_DBG_EXIT_SHIFT … #define TPC0_EML_CFG_DBG_CNT_DBG_EXIT_MASK … #define TPC0_EML_CFG_DBG_CNT_SNG_STEP_SHIFT … #define TPC0_EML_CFG_DBG_CNT_SNG_STEP_MASK … #define TPC0_EML_CFG_DBG_CNT_BP_DBGSW_EN_SHIFT … #define TPC0_EML_CFG_DBG_CNT_BP_DBGSW_EN_MASK … /* TPC0_EML_CFG_DBG_STS */ #define TPC0_EML_CFG_DBG_STS_DBG_MODE_SHIFT … #define TPC0_EML_CFG_DBG_STS_DBG_MODE_MASK … #define TPC0_EML_CFG_DBG_STS_CORE_READY_SHIFT … #define TPC0_EML_CFG_DBG_STS_CORE_READY_MASK … #define TPC0_EML_CFG_DBG_STS_DURING_KERNEL_SHIFT … #define TPC0_EML_CFG_DBG_STS_DURING_KERNEL_MASK … #define TPC0_EML_CFG_DBG_STS_ICACHE_IDLE_SHIFT … #define TPC0_EML_CFG_DBG_STS_ICACHE_IDLE_MASK … #define TPC0_EML_CFG_DBG_STS_DCACHE_IDLE_SHIFT … #define TPC0_EML_CFG_DBG_STS_DCACHE_IDLE_MASK … #define TPC0_EML_CFG_DBG_STS_QM_IDLE_SHIFT … #define TPC0_EML_CFG_DBG_STS_QM_IDLE_MASK … #define TPC0_EML_CFG_DBG_STS_WQ_IDLE_SHIFT … #define TPC0_EML_CFG_DBG_STS_WQ_IDLE_MASK … #define TPC0_EML_CFG_DBG_STS_MSS_IDLE_SHIFT … #define TPC0_EML_CFG_DBG_STS_MSS_IDLE_MASK … #define TPC0_EML_CFG_DBG_STS_DBG_CAUSE_SHIFT … #define TPC0_EML_CFG_DBG_STS_DBG_CAUSE_MASK … /* TPC0_EML_CFG_DBG_PADD */ #define TPC0_EML_CFG_DBG_PADD_ADDRESS_SHIFT … #define TPC0_EML_CFG_DBG_PADD_ADDRESS_MASK … /* TPC0_EML_CFG_DBG_PADD_COUNT */ #define TPC0_EML_CFG_DBG_PADD_COUNT_COUNT_SHIFT … #define TPC0_EML_CFG_DBG_PADD_COUNT_COUNT_MASK … /* TPC0_EML_CFG_DBG_PADD_COUNT_MATCH */ #define TPC0_EML_CFG_DBG_PADD_COUNT_MATCH_COUNT_SHIFT … #define TPC0_EML_CFG_DBG_PADD_COUNT_MATCH_COUNT_MASK … /* TPC0_EML_CFG_DBG_PADD_EN */ #define TPC0_EML_CFG_DBG_PADD_EN_ENABLE0_SHIFT … #define TPC0_EML_CFG_DBG_PADD_EN_ENABLE0_MASK … #define TPC0_EML_CFG_DBG_PADD_EN_ENABLE1_SHIFT … #define TPC0_EML_CFG_DBG_PADD_EN_ENABLE1_MASK … #define TPC0_EML_CFG_DBG_PADD_EN_ENABLE2_SHIFT … #define TPC0_EML_CFG_DBG_PADD_EN_ENABLE2_MASK … #define TPC0_EML_CFG_DBG_PADD_EN_ENABLE3_SHIFT … #define TPC0_EML_CFG_DBG_PADD_EN_ENABLE3_MASK … #define TPC0_EML_CFG_DBG_PADD_EN_ENABLE4_SHIFT … #define TPC0_EML_CFG_DBG_PADD_EN_ENABLE4_MASK … #define TPC0_EML_CFG_DBG_PADD_EN_ENABLE5_SHIFT … #define TPC0_EML_CFG_DBG_PADD_EN_ENABLE5_MASK … #define TPC0_EML_CFG_DBG_PADD_EN_ENABLE6_SHIFT … #define TPC0_EML_CFG_DBG_PADD_EN_ENABLE6_MASK … #define TPC0_EML_CFG_DBG_PADD_EN_ENABLE7_SHIFT … #define TPC0_EML_CFG_DBG_PADD_EN_ENABLE7_MASK … /* TPC0_EML_CFG_DBG_VPADD_HIGH */ #define TPC0_EML_CFG_DBG_VPADD_HIGH_ADDRESS_SHIFT … #define TPC0_EML_CFG_DBG_VPADD_HIGH_ADDRESS_MASK … /* TPC0_EML_CFG_DBG_VPADD_LOW */ #define TPC0_EML_CFG_DBG_VPADD_LOW_ADDRESS_SHIFT … #define TPC0_EML_CFG_DBG_VPADD_LOW_ADDRESS_MASK … /* TPC0_EML_CFG_DBG_VPADD_COUNT */ #define TPC0_EML_CFG_DBG_VPADD_COUNT_COUNT_SHIFT … #define TPC0_EML_CFG_DBG_VPADD_COUNT_COUNT_MASK … /* TPC0_EML_CFG_DBG_VPADD_COUNT_MATCH */ #define TPC0_EML_CFG_DBG_VPADD_COUNT_MATCH_COUNT_SHIFT … #define TPC0_EML_CFG_DBG_VPADD_COUNT_MATCH_COUNT_MASK … /* TPC0_EML_CFG_DBG_VPADD_EN */ #define TPC0_EML_CFG_DBG_VPADD_EN_ENABLE0_SHIFT … #define TPC0_EML_CFG_DBG_VPADD_EN_ENABLE0_MASK … #define TPC0_EML_CFG_DBG_VPADD_EN_ENABLE1_SHIFT … #define TPC0_EML_CFG_DBG_VPADD_EN_ENABLE1_MASK … #define TPC0_EML_CFG_DBG_VPADD_EN_RW_N0_SHIFT … #define TPC0_EML_CFG_DBG_VPADD_EN_RW_N0_MASK … #define TPC0_EML_CFG_DBG_VPADD_EN_RW_N1_SHIFT … #define TPC0_EML_CFG_DBG_VPADD_EN_RW_N1_MASK … /* TPC0_EML_CFG_DBG_SPADD_HIGH */ #define TPC0_EML_CFG_DBG_SPADD_HIGH_ADDRESS_SHIFT … #define TPC0_EML_CFG_DBG_SPADD_HIGH_ADDRESS_MASK … /* TPC0_EML_CFG_DBG_SPADD_LOW */ #define TPC0_EML_CFG_DBG_SPADD_LOW_ADDRESS_SHIFT … #define TPC0_EML_CFG_DBG_SPADD_LOW_ADDRESS_MASK … /* TPC0_EML_CFG_DBG_SPADD_COUNT */ #define TPC0_EML_CFG_DBG_SPADD_COUNT_COUNT_SHIFT … #define TPC0_EML_CFG_DBG_SPADD_COUNT_COUNT_MASK … /* TPC0_EML_CFG_DBG_SPADD_COUNT_MATCH */ #define TPC0_EML_CFG_DBG_SPADD_COUNT_MATCH_COUNT_SHIFT … #define TPC0_EML_CFG_DBG_SPADD_COUNT_MATCH_COUNT_MASK … /* TPC0_EML_CFG_DBG_SPADD_EN */ #define TPC0_EML_CFG_DBG_SPADD_EN_ENABLE0_SHIFT … #define TPC0_EML_CFG_DBG_SPADD_EN_ENABLE0_MASK … #define TPC0_EML_CFG_DBG_SPADD_EN_ENABLE1_SHIFT … #define TPC0_EML_CFG_DBG_SPADD_EN_ENABLE1_MASK … #define TPC0_EML_CFG_DBG_SPADD_EN_RW_N0_SHIFT … #define TPC0_EML_CFG_DBG_SPADD_EN_RW_N0_MASK … #define TPC0_EML_CFG_DBG_SPADD_EN_RW_N1_SHIFT … #define TPC0_EML_CFG_DBG_SPADD_EN_RW_N1_MASK … /* TPC0_EML_CFG_DBG_AGUADD_MSB_HIGH */ #define TPC0_EML_CFG_DBG_AGUADD_MSB_HIGH_ADDRESS_SHIFT … #define TPC0_EML_CFG_DBG_AGUADD_MSB_HIGH_ADDRESS_MASK … /* TPC0_EML_CFG_DBG_AGUADD_MSB_LOW */ #define TPC0_EML_CFG_DBG_AGUADD_MSB_LOW_ADDRESS_SHIFT … #define TPC0_EML_CFG_DBG_AGUADD_MSB_LOW_ADDRESS_MASK … /* TPC0_EML_CFG_DBG_AGUADD_LSB_HIGH */ #define TPC0_EML_CFG_DBG_AGUADD_LSB_HIGH_ADDRESS_SHIFT … #define TPC0_EML_CFG_DBG_AGUADD_LSB_HIGH_ADDRESS_MASK … /* TPC0_EML_CFG_DBG_AGUADD_LSB_LOW */ #define TPC0_EML_CFG_DBG_AGUADD_LSB_LOW_ADDRESS_SHIFT … #define TPC0_EML_CFG_DBG_AGUADD_LSB_LOW_ADDRESS_MASK … /* TPC0_EML_CFG_DBG_AGUADD_COUNT */ #define TPC0_EML_CFG_DBG_AGUADD_COUNT_COUNT_SHIFT … #define TPC0_EML_CFG_DBG_AGUADD_COUNT_COUNT_MASK … /* TPC0_EML_CFG_DBG_AGUADD_COUNT_MATCH */ #define TPC0_EML_CFG_DBG_AGUADD_COUNT_MATCH_COUNT_SHIFT … #define TPC0_EML_CFG_DBG_AGUADD_COUNT_MATCH_COUNT_MASK … /* TPC0_EML_CFG_DBG_AGUADD_EN */ #define TPC0_EML_CFG_DBG_AGUADD_EN_ENABLE0_SHIFT … #define TPC0_EML_CFG_DBG_AGUADD_EN_ENABLE0_MASK … #define TPC0_EML_CFG_DBG_AGUADD_EN_ENABLE1_SHIFT … #define TPC0_EML_CFG_DBG_AGUADD_EN_ENABLE1_MASK … #define TPC0_EML_CFG_DBG_AGUADD_EN_RW_N0_SHIFT … #define TPC0_EML_CFG_DBG_AGUADD_EN_RW_N0_MASK … #define TPC0_EML_CFG_DBG_AGUADD_EN_RW_N1_SHIFT … #define TPC0_EML_CFG_DBG_AGUADD_EN_RW_N1_MASK … /* TPC0_EML_CFG_DBG_AXIHBWADD_MSB_HIGH */ #define TPC0_EML_CFG_DBG_AXIHBWADD_MSB_HIGH_ADDRESS_SHIFT … #define TPC0_EML_CFG_DBG_AXIHBWADD_MSB_HIGH_ADDRESS_MASK … /* TPC0_EML_CFG_DBG_AXIHBWADD_MSB_LOW */ #define TPC0_EML_CFG_DBG_AXIHBWADD_MSB_LOW_ADDRESS_SHIFT … #define TPC0_EML_CFG_DBG_AXIHBWADD_MSB_LOW_ADDRESS_MASK … /* TPC0_EML_CFG_DBG_AXIHBWADD_LSB_HIGH */ #define TPC0_EML_CFG_DBG_AXIHBWADD_LSB_HIGH_ADDRESS_SHIFT … #define TPC0_EML_CFG_DBG_AXIHBWADD_LSB_HIGH_ADDRESS_MASK … /* TPC0_EML_CFG_DBG_AXIHBWADD_LSB_LOW */ #define TPC0_EML_CFG_DBG_AXIHBWADD_LSB_LOW_ADDRESS_SHIFT … #define TPC0_EML_CFG_DBG_AXIHBWADD_LSB_LOW_ADDRESS_MASK … /* TPC0_EML_CFG_DBG_AXIHBWADD_COUNT */ #define TPC0_EML_CFG_DBG_AXIHBWADD_COUNT_COUNT_SHIFT … #define TPC0_EML_CFG_DBG_AXIHBWADD_COUNT_COUNT_MASK … /* TPC0_EML_CFG_DBG_AXIHBWADD_COUNT_MATCH */ #define TPC0_EML_CFG_DBG_AXIHBWADD_COUNT_MATCH_MATCH_SHIFT … #define TPC0_EML_CFG_DBG_AXIHBWADD_COUNT_MATCH_MATCH_MASK … /* TPC0_EML_CFG_DBG_AXIHBWADD_EN */ #define TPC0_EML_CFG_DBG_AXIHBWADD_EN_ENABLE0_SHIFT … #define TPC0_EML_CFG_DBG_AXIHBWADD_EN_ENABLE0_MASK … #define TPC0_EML_CFG_DBG_AXIHBWADD_EN_ENABLE1_SHIFT … #define TPC0_EML_CFG_DBG_AXIHBWADD_EN_ENABLE1_MASK … #define TPC0_EML_CFG_DBG_AXIHBWADD_EN_RW_N0_SHIFT … #define TPC0_EML_CFG_DBG_AXIHBWADD_EN_RW_N0_MASK … #define TPC0_EML_CFG_DBG_AXIHBWADD_EN_RW_N1_SHIFT … #define TPC0_EML_CFG_DBG_AXIHBWADD_EN_RW_N1_MASK … /* TPC0_EML_CFG_DBG_AXILBWADD_MSB_HIGH */ #define TPC0_EML_CFG_DBG_AXILBWADD_MSB_HIGH_ADDRESS_SHIFT … #define TPC0_EML_CFG_DBG_AXILBWADD_MSB_HIGH_ADDRESS_MASK … /* TPC0_EML_CFG_DBG_AXILBWADD_MSB_LOW */ #define TPC0_EML_CFG_DBG_AXILBWADD_MSB_LOW_ADDRESS_SHIFT … #define TPC0_EML_CFG_DBG_AXILBWADD_MSB_LOW_ADDRESS_MASK … /* TPC0_EML_CFG_DBG_AXILBWADD_LSB_HIGH */ #define TPC0_EML_CFG_DBG_AXILBWADD_LSB_HIGH_ADDRESS_SHIFT … #define TPC0_EML_CFG_DBG_AXILBWADD_LSB_HIGH_ADDRESS_MASK … /* TPC0_EML_CFG_DBG_AXILBWADD_LSB_LOW */ #define TPC0_EML_CFG_DBG_AXILBWADD_LSB_LOW_ADDRESS_SHIFT … #define TPC0_EML_CFG_DBG_AXILBWADD_LSB_LOW_ADDRESS_MASK … /* TPC0_EML_CFG_DBG_AXILBWADD_COUNT */ #define TPC0_EML_CFG_DBG_AXILBWADD_COUNT_COUNT_SHIFT … #define TPC0_EML_CFG_DBG_AXILBWADD_COUNT_COUNT_MASK … /* TPC0_EML_CFG_DBG_AXILBWADD_COUNT_MATCH */ #define TPC0_EML_CFG_DBG_AXILBWADD_COUNT_MATCH_MATCH_SHIFT … #define TPC0_EML_CFG_DBG_AXILBWADD_COUNT_MATCH_MATCH_MASK … /* TPC0_EML_CFG_DBG_AXILBWADD_EN */ #define TPC0_EML_CFG_DBG_AXILBWADD_EN_ENABLE0_SHIFT … #define TPC0_EML_CFG_DBG_AXILBWADD_EN_ENABLE0_MASK … #define TPC0_EML_CFG_DBG_AXILBWADD_EN_ENABLE1_SHIFT … #define TPC0_EML_CFG_DBG_AXILBWADD_EN_ENABLE1_MASK … #define TPC0_EML_CFG_DBG_AXILBWADD_EN_RW_N0_SHIFT … #define TPC0_EML_CFG_DBG_AXILBWADD_EN_RW_N0_MASK … #define TPC0_EML_CFG_DBG_AXILBWADD_EN_RW_N1_SHIFT … #define TPC0_EML_CFG_DBG_AXILBWADD_EN_RW_N1_MASK … /* TPC0_EML_CFG_DBG_SPDATA */ #define TPC0_EML_CFG_DBG_SPDATA_DATA_SHIFT … #define TPC0_EML_CFG_DBG_SPDATA_DATA_MASK … /* TPC0_EML_CFG_DBG_SPDATA_COUNT */ #define TPC0_EML_CFG_DBG_SPDATA_COUNT_COUNT_SHIFT … #define TPC0_EML_CFG_DBG_SPDATA_COUNT_COUNT_MASK … /* TPC0_EML_CFG_DBG_SPDATA_COUNT_MATCH */ #define TPC0_EML_CFG_DBG_SPDATA_COUNT_MATCH_MATCH_SHIFT … #define TPC0_EML_CFG_DBG_SPDATA_COUNT_MATCH_MATCH_MASK … /* TPC0_EML_CFG_DBG_SPDATA_EN */ #define TPC0_EML_CFG_DBG_SPDATA_EN_ENABLE0_SHIFT … #define TPC0_EML_CFG_DBG_SPDATA_EN_ENABLE0_MASK … #define TPC0_EML_CFG_DBG_SPDATA_EN_ENABLE1_SHIFT … #define TPC0_EML_CFG_DBG_SPDATA_EN_ENABLE1_MASK … #define TPC0_EML_CFG_DBG_SPDATA_EN_RW_N0_SHIFT … #define TPC0_EML_CFG_DBG_SPDATA_EN_RW_N0_MASK … #define TPC0_EML_CFG_DBG_SPDATA_EN_RW_N1_SHIFT … #define TPC0_EML_CFG_DBG_SPDATA_EN_RW_N1_MASK … /* TPC0_EML_CFG_DBG_AXIHBWDATA */ #define TPC0_EML_CFG_DBG_AXIHBWDATA_DATA_SHIFT … #define TPC0_EML_CFG_DBG_AXIHBWDATA_DATA_MASK … /* TPC0_EML_CFG_DBG_AXIHBWDATA_COUNT */ #define TPC0_EML_CFG_DBG_AXIHBWDATA_COUNT_COUNT_SHIFT … #define TPC0_EML_CFG_DBG_AXIHBWDATA_COUNT_COUNT_MASK … /* TPC0_EML_CFG_DBG_AXIHBWDAT_COUNT_MATCH */ #define TPC0_EML_CFG_DBG_AXIHBWDAT_COUNT_MATCH_COUNT_SHIFT … #define TPC0_EML_CFG_DBG_AXIHBWDAT_COUNT_MATCH_COUNT_MASK … /* TPC0_EML_CFG_DBG_AXIHBWDATA_EN */ #define TPC0_EML_CFG_DBG_AXIHBWDATA_EN_ENABLE_SHIFT … #define TPC0_EML_CFG_DBG_AXIHBWDATA_EN_ENABLE_MASK … #define TPC0_EML_CFG_DBG_AXIHBWDATA_EN_RW_N_SHIFT … #define TPC0_EML_CFG_DBG_AXIHBWDATA_EN_RW_N_MASK … /* TPC0_EML_CFG_DBG_AXILBWDATA */ #define TPC0_EML_CFG_DBG_AXILBWDATA_DATA_SHIFT … #define TPC0_EML_CFG_DBG_AXILBWDATA_DATA_MASK … /* TPC0_EML_CFG_DBG_AXILBWDATA_COUNT */ #define TPC0_EML_CFG_DBG_AXILBWDATA_COUNT_COUNT_SHIFT … #define TPC0_EML_CFG_DBG_AXILBWDATA_COUNT_COUNT_MASK … /* TPC0_EML_CFG_DBG_AXILBWDAT_COUNT_MATCH */ #define TPC0_EML_CFG_DBG_AXILBWDAT_COUNT_MATCH_MATCH_SHIFT … #define TPC0_EML_CFG_DBG_AXILBWDAT_COUNT_MATCH_MATCH_MASK … /* TPC0_EML_CFG_DBG_AXILBWDATA_EN */ #define TPC0_EML_CFG_DBG_AXILBWDATA_EN_ENABLE_SHIFT … #define TPC0_EML_CFG_DBG_AXILBWDATA_EN_ENABLE_MASK … #define TPC0_EML_CFG_DBG_AXILBWDATA_EN_RW_N_SHIFT … #define TPC0_EML_CFG_DBG_AXILBWDATA_EN_RW_N_MASK … /* TPC0_EML_CFG_DBG_D0_PC */ #define TPC0_EML_CFG_DBG_D0_PC_PC_SHIFT … #define TPC0_EML_CFG_DBG_D0_PC_PC_MASK … /* TPC0_EML_CFG_RTTCONFIG */ #define TPC0_EML_CFG_RTTCONFIG_TR_EN_SHIFT … #define TPC0_EML_CFG_RTTCONFIG_TR_EN_MASK … #define TPC0_EML_CFG_RTTCONFIG_PRIO_SHIFT … #define TPC0_EML_CFG_RTTCONFIG_PRIO_MASK … /* TPC0_EML_CFG_RTTPREDICATE */ #define TPC0_EML_CFG_RTTPREDICATE_TR_EN_SHIFT … #define TPC0_EML_CFG_RTTPREDICATE_TR_EN_MASK … #define TPC0_EML_CFG_RTTPREDICATE_GEN_SHIFT … #define TPC0_EML_CFG_RTTPREDICATE_GEN_MASK … #define TPC0_EML_CFG_RTTPREDICATE_USE_INTERVAL_SHIFT … #define TPC0_EML_CFG_RTTPREDICATE_USE_INTERVAL_MASK … #define TPC0_EML_CFG_RTTPREDICATE_SPRF_MASK_SHIFT … #define TPC0_EML_CFG_RTTPREDICATE_SPRF_MASK_MASK … /* TPC0_EML_CFG_RTTPREDICATE_INTV */ #define TPC0_EML_CFG_RTTPREDICATE_INTV_INTERVAL_SHIFT … #define TPC0_EML_CFG_RTTPREDICATE_INTV_INTERVAL_MASK … /* TPC0_EML_CFG_RTTTS */ #define TPC0_EML_CFG_RTTTS_TR_EN_SHIFT … #define TPC0_EML_CFG_RTTTS_TR_EN_MASK … #define TPC0_EML_CFG_RTTTS_GEN_SHIFT … #define TPC0_EML_CFG_RTTTS_GEN_MASK … #define TPC0_EML_CFG_RTTTS_COMPRESS_EN_SHIFT … #define TPC0_EML_CFG_RTTTS_COMPRESS_EN_MASK … /* TPC0_EML_CFG_RTTTS_INTV */ #define TPC0_EML_CFG_RTTTS_INTV_INTERVAL_SHIFT … #define TPC0_EML_CFG_RTTTS_INTV_INTERVAL_MASK … /* TPC0_EML_CFG_DBG_INST_INSERT */ #define TPC0_EML_CFG_DBG_INST_INSERT_INST_SHIFT … #define TPC0_EML_CFG_DBG_INST_INSERT_INST_MASK … /* TPC0_EML_CFG_DBG_INST_INSERT_CTL */ #define TPC0_EML_CFG_DBG_INST_INSERT_CTL_INSERT_SHIFT … #define TPC0_EML_CFG_DBG_INST_INSERT_CTL_INSERT_MASK … #endif /* ASIC_REG_TPC0_EML_CFG_MASKS_H_ */
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