/* SPDX-License-Identifier: (GPL-2.0-only OR BSD-2-Clause) */
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#ifndef _DT_BINDINGS_CLK_QCOM_GCC_X1E80100_H
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/* GCC clocks */
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#define GCC_VIDEO_AHB_CLK 344
#define GCC_VIDEO_AXI0_CLK 345
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/* GCC power domains */
#define GCC_PCIE_0_TUNNEL_GDSC 0
#define GCC_PCIE_1_TUNNEL_GDSC 1
#define GCC_PCIE_2_TUNNEL_GDSC 2
#define GCC_PCIE_3_GDSC 3
#define GCC_PCIE_3_PHY_GDSC 4
#define GCC_PCIE_4_GDSC 5
#define GCC_PCIE_4_PHY_GDSC 6
#define GCC_PCIE_5_GDSC 7
#define GCC_PCIE_5_PHY_GDSC 8
#define GCC_PCIE_6_PHY_GDSC 9
#define GCC_PCIE_6A_GDSC 10
#define GCC_PCIE_6B_GDSC 11
#define GCC_UFS_MEM_PHY_GDSC 12
#define GCC_UFS_PHY_GDSC 13
#define GCC_USB20_PRIM_GDSC 14
#define GCC_USB30_MP_GDSC 15
#define GCC_USB30_PRIM_GDSC 16
#define GCC_USB30_SEC_GDSC 17
#define GCC_USB30_TERT_GDSC 18
#define GCC_USB3_MP_SS0_PHY_GDSC 19
#define GCC_USB3_MP_SS1_PHY_GDSC 20
#define GCC_USB4_0_GDSC 21
#define GCC_USB4_1_GDSC 22
#define GCC_USB4_2_GDSC 23
#define GCC_USB_0_PHY_GDSC 24
#define GCC_USB_1_PHY_GDSC 25
#define GCC_USB_2_PHY_GDSC 26
/* GCC resets */
#define GCC_AV1E_BCR 0
#define GCC_CAMERA_BCR 1
#define GCC_DISPLAY_BCR 2
#define GCC_GPU_BCR 3
#define GCC_PCIE_0_LINK_DOWN_BCR 4
#define GCC_PCIE_0_NOCSR_COM_PHY_BCR 5
#define GCC_PCIE_0_PHY_BCR 6
#define GCC_PCIE_0_PHY_NOCSR_COM_PHY_BCR 7
#define GCC_PCIE_0_TUNNEL_BCR 8
#define GCC_PCIE_1_LINK_DOWN_BCR 9
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